waterline_adder

所属分类VHDL/FPGA/Verilog
开发工具:VHDL
文件大小:1KB
澳门威尼斯人官网次数:44
上传日期:2009-07-02 10:28:14
上 传 者夏海颖
说明:  这是一个用Verilog编写的四级流水线加法器
(This is a Verilog prepared with four pipeline adder)

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